- 以ADC0809为例，设计一个ADC采样控制电路，采用有限状态机的方式。 传统的ADC采样控制的方法是用单片机控制，单片机控制ADC采样具有编程简单，控制灵活的优点，但是采样速度慢，CPU控制的低速极大地限制了ADC器件告诉性能的发挥，在高速ADC控制中，目前基本上都是使用可编程逻辑器件来完成。 下面是ADC0809的内部电路图： 引脚图： 引脚功能： ... 以ADC0809为例，设计一个ADC采样控制电路，采用有限状态机的方式。 传统的ADC采样控制的方法是用单片机控制，单片机控制ADC采样具有编程简单，控制灵活的优点，但是采样速度慢，CPU控制的低速极大地限制了ADC器件告诉性能的发挥，在高速ADC控制中，目前基本上都是使用可编程逻辑器件来完成。 下面是ADC0809的内部电路图： 引脚图： 引脚功能： ...
- Half-band Filter As previously described, every second filter coefficient for a half-band filter with an odd number of terms is zero. When specifying the filter coefficient data for this f... Half-band Filter As previously described, every second filter coefficient for a half-band filter with an odd number of terms is zero. When specifying the filter coefficient data for this f...
- FPGA内部时序单元到输出端口的路径也需要约束其output delay，如图1所示框图。 图1 约束output delay的命令是set_output_delay，具体的参数如下： set_output_delay –clock reference_clock –min... FPGA内部时序单元到输出端口的路径也需要约束其output delay，如图1所示框图。 图1 约束output delay的命令是set_output_delay，具体的参数如下： set_output_delay –clock reference_clock –min...
- Filter Coefficient Data 滤波器系数使用扩展名为.coe的系数文件提供给FIR编译器。 这是一个ASCII文本文件，带有单行标题，用于定义用于系数数据的数字表示的基数，后跟系数值本身。 对于N抽头滤波器，如图3-36所示。 滤波器系数可以以整数的形式提供，可以是基-10、基-16或基-2表示。系数为10，系数为16，系数为2。这句话的英文原版更好... Filter Coefficient Data 滤波器系数使用扩展名为.coe的系数文件提供给FIR编译器。 这是一个ASCII文本文件，带有单行标题，用于定义用于系数数据的数字表示的基数，后跟系数值本身。 对于N抽头滤波器，如图3-36所示。 滤波器系数可以以整数的形式提供，可以是基-10、基-16或基-2表示。系数为10，系数为16，系数为2。这句话的英文原版更好...
- 超声波测距原理： 超声波测距原理是在超声波发射装置发出超声波，它的根据是接收器接到超声波时的时间差，与雷达测距原理相似。 超声波发射器向某一方向发射超声波，在发射时刻的同时开始计时，超声波在空气中传播，途中碰到障碍物就立即返回来，超声波接收器收到反射波就立即停止计时。 （超声波在空气中的传播速度为340m/s，根据计时器记录的时间t（秒），就可以计算出发射点距障碍物的距离... 超声波测距原理： 超声波测距原理是在超声波发射装置发出超声波，它的根据是接收器接到超声波时的时间差，与雷达测距原理相似。 超声波发射器向某一方向发射超声波，在发射时刻的同时开始计时，超声波在空气中传播，途中碰到障碍物就立即返回来，超声波接收器收到反射波就立即停止计时。 （超声波在空气中的传播速度为340m/s，根据计时器记录的时间t（秒），就可以计算出发射点距障碍物的距离...
- RTL设计 在RTL设计中，将想要抓取的信号前加上： (*KEEP = "TRUE"*) reg led_reg02; 例如，本例中需要抓取的信号是led_reg02； ILA核的生成及例化 之后生成一个ILA核，如下： 点击OK，生成ILA核完毕。之后在程序中例化ILA核： 给出例化程序部分： ila_0 ila_s... RTL设计 在RTL设计中，将想要抓取的信号前加上： (*KEEP = "TRUE"*) reg led_reg02; 例如，本例中需要抓取的信号是led_reg02； ILA核的生成及例化 之后生成一个ILA核，如下： 点击OK，生成ILA核完毕。之后在程序中例化ILA核： 给出例化程序部分： ila_0 ila_s...
- 待续 待续
- 上篇博文：半带 FIR 滤波器（Half-band FIR Filter） 希尔伯特变换在数字通信系统中有很多种使用方式。理想的希尔伯特变换为正频率提供90度的相移，为负频率提供-90度的相移。 希尔伯特变换接收一个实值信号，并且产生一个复的 （I, Q）输出信号。输出信号的正交部分（Q）由如图 3-22所示冲激响应的 FIR 滤波器产生。同相分量（I）是输入信号经过延时后... 上篇博文：半带 FIR 滤波器（Half-band FIR Filter） 希尔伯特变换在数字通信系统中有很多种使用方式。理想的希尔伯特变换为正频率提供90度的相移，为负频率提供-90度的相移。 希尔伯特变换接收一个实值信号，并且产生一个复的 （I, Q）输出信号。输出信号的正交部分（Q）由如图 3-22所示冲激响应的 FIR 滤波器产生。同相分量（I）是输入信号经过延时后...
- 1、什么是高阻态？ 高阻态：电路的一种输出状态，既不是高电平也不是低电平，如果高阻态再输入下一级电路的话，对下级电路无任何影响，可以理解为断路，不被任何东西所驱动，也不驱动任何东西。 之前写过和高阻态相关的博文：https://blog.csdn.net/Reborn_Lee/article/details/83756121 2、集成时钟门控单元（Integrated... 1、什么是高阻态？ 高阻态：电路的一种输出状态，既不是高电平也不是低电平，如果高阻态再输入下一级电路的话，对下级电路无任何影响，可以理解为断路，不被任何东西所驱动，也不驱动任何东西。 之前写过和高阻态相关的博文：https://blog.csdn.net/Reborn_Lee/article/details/83756121 2、集成时钟门控单元（Integrated...
- 上篇博文：测了回响脉冲的宽度为多少个10us，这篇博文要算出距离，且用数码管显示距离的十进制结果。 功能框图如下： 、 距离计算： 还是先给出程序之后在简单解释吧。 顶层模块： ///工程硬件平台： Xilinx Spartan 6 FPGA///每100ms产生1个超声波测距模块所需的10us高脉冲激励，并用数码管以10进制数据显示最... 上篇博文：测了回响脉冲的宽度为多少个10us，这篇博文要算出距离，且用数码管显示距离的十进制结果。 功能框图如下： 、 距离计算： 还是先给出程序之后在简单解释吧。 顶层模块： ///工程硬件平台： Xilinx Spartan 6 FPGA///每100ms产生1个超声波测距模块所需的10us高脉冲激励，并用数码管以10进制数据显示最...
- 目录 （1）什么情况下，时钟应该“上树”？ （2）如何选择时钟树？ （3）时钟信号如何“上树”？ （4）被“拉下树”的时钟信号 上篇博文：时钟域问题简介，介绍了时钟域的相关知识，形象的说就是时钟信号的“势力”范围，它通过时钟树的形式实现。 时钟树不仅可以做到高扇出，还可以做到让时钟信号到达各个触发器的时刻尽可能一致，也即保证时钟信号到达时钟域内... 目录 （1）什么情况下，时钟应该“上树”？ （2）如何选择时钟树？ （3）时钟信号如何“上树”？ （4）被“拉下树”的时钟信号 上篇博文：时钟域问题简介，介绍了时钟域的相关知识，形象的说就是时钟信号的“势力”范围，它通过时钟树的形式实现。 时钟树不仅可以做到高扇出，还可以做到让时钟信号到达各个触发器的时刻尽可能一致，也即保证时钟信号到达时钟域内...
- 先写个模子在这里，后面填充说明内容。 &nb... 先写个模子在这里，后面填充说明内容。 &nb...
- 使用MATLAB生成滤波器有很多学问，这里只是作为初步的探索，和FPGA的更多结合，也正在探索中，相关博文例如：【 FPGA 】FIR滤波器目录，该专题目录正在记录我学习FIR滤波器的过程。 MATLAB生成30阶低通1MHz海明窗函数设计步骤： （1）在MATLAB命令窗口中输入“fdatool”出现如下对话框： 注意，在MATLAB2018以后的版... 使用MATLAB生成滤波器有很多学问，这里只是作为初步的探索，和FPGA的更多结合，也正在探索中，相关博文例如：【 FPGA 】FIR滤波器目录，该专题目录正在记录我学习FIR滤波器的过程。 MATLAB生成30阶低通1MHz海明窗函数设计步骤： （1）在MATLAB命令窗口中输入“fdatool”出现如下对话框： 注意，在MATLAB2018以后的版...
- 记录一个小实验吧，实验的目的是仅仅是塞塞牙缝而已，没其他意思，很简单。 功能：拨码开关控制led灯工作与否，拨码开关为on，led灯工作，否则不工作；导航按键up和down，也就是独立按键而已，控制led等流动方向。当按下导航开关up时，led灯从高到低流动，按下down时，led灯从低到高流动。 分析：拨码开关没啥说的，很简单，拨码开关为on，也就是为低电平时，用一个使... 记录一个小实验吧，实验的目的是仅仅是塞塞牙缝而已，没其他意思，很简单。 功能：拨码开关控制led灯工作与否，拨码开关为on，led灯工作，否则不工作；导航按键up和down，也就是独立按键而已，控制led等流动方向。当按下导航开关up时，led灯从高到低流动，按下down时，led灯从低到高流动。 分析：拨码开关没啥说的，很简单，拨码开关为on，也就是为低电平时，用一个使...
- 今天看用选择器实现总线设计的程序中（【 FPGA 】总线实现形式之选择器），选择器控制信号部分用到了抢占式优先级译码器，这里单独把这个抢先式优先级译码器抽出来讲讲看： 高位优先，下面是Verilog HDL代码： `timescale 1ns / 1ps//// Company: // Engineer: // // Create Date: 11:49:31 11/05... 今天看用选择器实现总线设计的程序中（【 FPGA 】总线实现形式之选择器），选择器控制信号部分用到了抢占式优先级译码器，这里单独把这个抢先式优先级译码器抽出来讲讲看： 高位优先，下面是Verilog HDL代码： `timescale 1ns / 1ps//// Company: // Engineer: // // Create Date: 11:49:31 11/05...
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