- 上篇博文讲了使用Moore状态机来设计一个序列检测器：序列检测器的Moore状态机实现 原理一致，这里只不过采用了Mealy状态机实现，快速给出： 状态转移图如下：被检测序列为1101，也就是说，如果出现1101序列，则输出为1，否则输出为0。 Verilog HDL代码为： `timescale 1ns / 1ps//// Company: // Enginee... 上篇博文讲了使用Moore状态机来设计一个序列检测器：序列检测器的Moore状态机实现 原理一致，这里只不过采用了Mealy状态机实现，快速给出： 状态转移图如下：被检测序列为1101，也就是说，如果出现1101序列，则输出为1，否则输出为0。 Verilog HDL代码为： `timescale 1ns / 1ps//// Company: // Enginee...
- MultiBoot的大致过程如下图： MultiBoot的配置文件由两个比特流文件生成，第一个为备份文件，永远都不会变，称为Golden_image，从Flash的0地址存储。 第二个为更新文件，后面远程更新，更新的就是这个文件，称为Update_image，存放在某个地址处，这个地址有热启动地址寄存器（WBSTAR）指定。 配置过程大致如下： FPGA从FLASH的... MultiBoot的大致过程如下图： MultiBoot的配置文件由两个比特流文件生成，第一个为备份文件，永远都不会变，称为Golden_image，从Flash的0地址存储。 第二个为更新文件，后面远程更新，更新的就是这个文件，称为Update_image，存放在某个地址处，这个地址有热启动地址寄存器（WBSTAR）指定。 配置过程大致如下： FPGA从FLASH的...
- 文章目录 前言时空变换之时间换空间逻辑合并模块复用之提速复用原理简单提速复用复杂提速复用一个简单的FIR滤波器FIR滤波器的转置结构多路FIR滤波需求初步分析提速后的问题分析FIR滤波器的复用方案FIR滤波器的其它优化复杂提速复用的一般形式 缓存提速复用 前言 前面一篇博客说了空域优化的时空变换内容，大概内容就是适当去除冗余以及分时复用，资源合... 文章目录 前言时空变换之时间换空间逻辑合并模块复用之提速复用原理简单提速复用复杂提速复用一个简单的FIR滤波器FIR滤波器的转置结构多路FIR滤波需求初步分析提速后的问题分析FIR滤波器的复用方案FIR滤波器的其它优化复杂提速复用的一般形式 缓存提速复用 前言 前面一篇博客说了空域优化的时空变换内容，大概内容就是适当去除冗余以及分时复用，资源合...
- 在Verilog HDL中，使用localparam（局部参数）声明常量，可以使代码清晰并有助于以后的维护，例如声明数据总线的位宽和范围： localparam DATA_WIDTH = 8; DATA_RANGE = 2**DATA_WIDTH; 或定义符号端口名称： UART_PORT = 4'b0001; LCD_PORT = 4'b001... 在Verilog HDL中，使用localparam（局部参数）声明常量，可以使代码清晰并有助于以后的维护，例如声明数据总线的位宽和范围： localparam DATA_WIDTH = 8; DATA_RANGE = 2**DATA_WIDTH; 或定义符号端口名称： UART_PORT = 4'b0001; LCD_PORT = 4'b001...
- 转载自：https://www.cnblogs.com/rouwawa/p/7102173.html 上两篇博文Cordic算法——圆周系统之旋转模式、Cordic算法——圆周系统之向量模式做了理论分析和实现，但是所用到的变量依然是浮点型，而cordic真正的用处是基于FPGA等只能处理定点的平台。只需将满足精度的浮点数，放大2^n倍，取整，... 转载自：https://www.cnblogs.com/rouwawa/p/7102173.html 上两篇博文Cordic算法——圆周系统之旋转模式、Cordic算法——圆周系统之向量模式做了理论分析和实现，但是所用到的变量依然是浮点型，而cordic真正的用处是基于FPGA等只能处理定点的平台。只需将满足精度的浮点数，放大2^n倍，取整，...
- 1、简述建立时间和保持时间，画图表示？ 建立时间Tsu（setup）：触发器在时钟上升沿到来之前，其数据输入端的数据必须保持不变的最小时间。 保持时间Th（hold）：触发器在时钟上升沿到来之后，其数据输入端的数据必须保持不变的最小时间。 2、简述触发器和锁存器之间的差别？ 锁存器对电平信号敏感，在输入脉冲的电平作用下改变状态。 D触发器对时钟边沿... 1、简述建立时间和保持时间，画图表示？ 建立时间Tsu（setup）：触发器在时钟上升沿到来之前，其数据输入端的数据必须保持不变的最小时间。 保持时间Th（hold）：触发器在时钟上升沿到来之后，其数据输入端的数据必须保持不变的最小时间。 2、简述触发器和锁存器之间的差别？ 锁存器对电平信号敏感，在输入脉冲的电平作用下改变状态。 D触发器对时钟边沿...
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- 固件远程更新之STARTUPE2原语（fpga控制flash） 上个格式不方便看，看这个转载的： https://blog.csdn.net/Reborn_Lee/article/details/89187417 针对所有 ISE 版本和 Vivado 2017.2 及更早版本的 Zynq-7000 SoC RSVDGND 引脚和 PL STARTUPE2 原语需求的... 固件远程更新之STARTUPE2原语（fpga控制flash） 上个格式不方便看，看这个转载的： https://blog.csdn.net/Reborn_Lee/article/details/89187417 针对所有 ISE 版本和 Vivado 2017.2 及更早版本的 Zynq-7000 SoC RSVDGND 引脚和 PL STARTUPE2 原语需求的...
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