- 这篇博文快速完成，对上篇博文的一个延续，用动态扫描数码管显示模块来显示回响信号的脉冲长度，从而知道测距值。 上篇博文：超声波测距小实验（一） 关于数码管的动态扫描显示的博文之前也写了几篇，这里直接调用其模块即可：控制数码管动态扫描显示的小实验 功能框图： 同样为25MHz的时钟频率，所以段选，片选模块可以直接使用： ///工程硬件平台： Xilinx Spa... 这篇博文快速完成，对上篇博文的一个延续，用动态扫描数码管显示模块来显示回响信号的脉冲长度，从而知道测距值。 上篇博文：超声波测距小实验（一） 关于数码管的动态扫描显示的博文之前也写了几篇，这里直接调用其模块即可：控制数码管动态扫描显示的小实验 功能框图： 同样为25MHz的时钟频率，所以段选，片选模块可以直接使用： ///工程硬件平台： Xilinx Spa...
- 组合逻辑和时序逻辑学习笔记 服完上篇博文的知识，再服用此博文效果更佳！认真看下去，其实还挺有意思。 本文来自于《从算法设计到硬件逻辑的实现》，仅供学习交流使用！ 我们知道，诸如加、减、乘、除、比较等运算都可以用组合逻辑来实现，但运算的输入必须稳定一段时间，才可能得到稳定的输出，而输出要被下一阶段的运算作为输入，也必须要有一段时间的稳定，因而输出结果必须保存在寄存器组中... 组合逻辑和时序逻辑学习笔记 服完上篇博文的知识，再服用此博文效果更佳！认真看下去，其实还挺有意思。 本文来自于《从算法设计到硬件逻辑的实现》，仅供学习交流使用！ 我们知道，诸如加、减、乘、除、比较等运算都可以用组合逻辑来实现，但运算的输入必须稳定一段时间，才可能得到稳定的输出，而输出要被下一阶段的运算作为输入，也必须要有一段时间的稳定，因而输出结果必须保存在寄存器组中...
- Vivado进行时序分析，对时钟的约束是必不可少的，设计中的时钟可分为一下几种： Primary Clocks 主时钟；Generated Clocks 衍生时钟；Virtual Clocks 虚拟时钟。 Primary Clocks 主时钟一般是FPGA外部芯片如晶振提供的时钟，通过FPGA引脚输入。Vivado进行时序分析时，以主时钟的源端点作为延时计算起... Vivado进行时序分析，对时钟的约束是必不可少的，设计中的时钟可分为一下几种： Primary Clocks 主时钟；Generated Clocks 衍生时钟；Virtual Clocks 虚拟时钟。 Primary Clocks 主时钟一般是FPGA外部芯片如晶振提供的时钟，通过FPGA引脚输入。Vivado进行时序分析时，以主时钟的源端点作为延时计算起...
- 前几篇博文提到了四种时序路径：基本的时序约束、分析的概念 1) FPGA内部时序单元间的路径 2) 输入端口到FPGA内部时序单元的路径 3) FPGA内部时序单元到输... 前几篇博文提到了四种时序路径：基本的时序约束、分析的概念 1) FPGA内部时序单元间的路径 2) 输入端口到FPGA内部时序单元的路径 3) FPGA内部时序单元到输...
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- 这是小实验还是接着上个小实验的：超声波测距小实验（一） 数码管显示回响信号脉冲宽度 先说说实验的要求： 超声波测距回响脉宽计数之均值滤波处理，每100ms产生1个超声波测距模块所需的10us高脉冲激励（超声波测距模块的触发信号），并用数码管以16进制数据显示经过滤波处理的回响信号的高脉冲计数值（以10us为单位）。 如下为功能框图： 滤波算法与实现： ... 这是小实验还是接着上个小实验的：超声波测距小实验（一） 数码管显示回响信号脉冲宽度 先说说实验的要求： 超声波测距回响脉宽计数之均值滤波处理，每100ms产生1个超声波测距模块所需的10us高脉冲激励（超声波测距模块的触发信号），并用数码管以16进制数据显示经过滤波处理的回响信号的高脉冲计数值（以10us为单位）。 如下为功能框图： 滤波算法与实现： ...
- 如何快速学会单片机编程并应用？ 先上一些参考资料，主要来源知乎： 1 -怎样学会单片机？- 2 -arduino、arm、树莓派、单片机四者有什么不同？- 3 -单片机可以替代PLC么？- 4 -单片机有没有必要用汇编讲？- 5 -相关课程- 单片机和C语言，是自动化（机器人）学科重要的基础内容。 如果对机器人感兴趣，可参考机器人工程师学习计划。 课程学习动机~Why？为什么... 如何快速学会单片机编程并应用？ 先上一些参考资料，主要来源知乎： 1 -怎样学会单片机？- 2 -arduino、arm、树莓派、单片机四者有什么不同？- 3 -单片机可以替代PLC么？- 4 -单片机有没有必要用汇编讲？- 5 -相关课程- 单片机和C语言，是自动化（机器人）学科重要的基础内容。 如果对机器人感兴趣，可参考机器人工程师学习计划。 课程学习动机~Why？为什么...
- 以ADC0809为例，设计一个ADC采样控制电路，采用有限状态机的方式。 传统的ADC采样控制的方法是用单片机控制，单片机控制ADC采样具有编程简单，控制灵活的优点，但是采样速度慢，CPU控制的低速极大地限制了ADC器件告诉性能的发挥，在高速ADC控制中，目前基本上都是使用可编程逻辑器件来完成。 下面是ADC0809的内部电路图： 引脚图： 引脚功能： ... 以ADC0809为例，设计一个ADC采样控制电路，采用有限状态机的方式。 传统的ADC采样控制的方法是用单片机控制，单片机控制ADC采样具有编程简单，控制灵活的优点，但是采样速度慢，CPU控制的低速极大地限制了ADC器件告诉性能的发挥，在高速ADC控制中，目前基本上都是使用可编程逻辑器件来完成。 下面是ADC0809的内部电路图： 引脚图： 引脚功能： ...
- 原文链接：上拉电阻和下拉电阻的作用 下拉就是接地，上拉就相当于升压，提高驱动能力或者稳定性。 上拉电阻是用来解决总线驱动能力不足时提供电流的问题的。一般说法是上拉增大电流，下拉电阻是用来吸收电流（抵抗干扰）。 上拉是将电压拉高，下拉是将电压拉低，主要用在三极管或场管的控制极的电位，因为只有满足电压差才会工作。 上拉电阻： 下拉电阻： 总之： 2者共同的... 原文链接：上拉电阻和下拉电阻的作用 下拉就是接地，上拉就相当于升压，提高驱动能力或者稳定性。 上拉电阻是用来解决总线驱动能力不足时提供电流的问题的。一般说法是上拉增大电流，下拉电阻是用来吸收电流（抵抗干扰）。 上拉是将电压拉高，下拉是将电压拉低，主要用在三极管或场管的控制极的电位，因为只有满足电压差才会工作。 上拉电阻： 下拉电阻： 总之： 2者共同的...
- FPGA内部时序单元到输出端口的路径也需要约束其output delay，如图1所示框图。 图1 约束output delay的命令是set_output_delay，具体的参数如下： set_output_delay –clock reference_clock –min... FPGA内部时序单元到输出端口的路径也需要约束其output delay，如图1所示框图。 图1 约束output delay的命令是set_output_delay，具体的参数如下： set_output_delay –clock reference_clock –min...
- 超声波测距原理： 超声波测距原理是在超声波发射装置发出超声波，它的根据是接收器接到超声波时的时间差，与雷达测距原理相似。 超声波发射器向某一方向发射超声波，在发射时刻的同时开始计时，超声波在空气中传播，途中碰到障碍物就立即返回来，超声波接收器收到反射波就立即停止计时。 （超声波在空气中的传播速度为340m/s，根据计时器记录的时间t（秒），就可以计算出发射点距障碍物的距离... 超声波测距原理： 超声波测距原理是在超声波发射装置发出超声波，它的根据是接收器接到超声波时的时间差，与雷达测距原理相似。 超声波发射器向某一方向发射超声波，在发射时刻的同时开始计时，超声波在空气中传播，途中碰到障碍物就立即返回来，超声波接收器收到反射波就立即停止计时。 （超声波在空气中的传播速度为340m/s，根据计时器记录的时间t（秒），就可以计算出发射点距障碍物的距离...
- 有时候会有这样的需求，就是之前在ISE上的工程，现在需要用Vivado来操作，这样其中的一部分工作就是将ISE上的时序约束文件UCF转换为XDC文件。 如下图1所示为UCF与SDC的约束命令比较，可以发现常用的命令都能对应上。 （图1） 下面简单举例说明： Clock Period： UCF ： NET "clka" TNM_NET = "clka"; TI... 有时候会有这样的需求，就是之前在ISE上的工程，现在需要用Vivado来操作，这样其中的一部分工作就是将ISE上的时序约束文件UCF转换为XDC文件。 如下图1所示为UCF与SDC的约束命令比较，可以发现常用的命令都能对应上。 （图1） 下面简单举例说明： Clock Period： UCF ： NET "clka" TNM_NET = "clka"; TI...
- 上篇博文：测了回响脉冲的宽度为多少个10us，这篇博文要算出距离，且用数码管显示距离的十进制结果。 功能框图如下： 、 距离计算： 还是先给出程序之后在简单解释吧。 顶层模块： ///工程硬件平台： Xilinx Spartan 6 FPGA///每100ms产生1个超声波测距模块所需的10us高脉冲激励，并用数码管以10进制数据显示最... 上篇博文：测了回响脉冲的宽度为多少个10us，这篇博文要算出距离，且用数码管显示距离的十进制结果。 功能框图如下： 、 距离计算： 还是先给出程序之后在简单解释吧。 顶层模块： ///工程硬件平台： Xilinx Spartan 6 FPGA///每100ms产生1个超声波测距模块所需的10us高脉冲激励，并用数码管以10进制数据显示最...
- 时钟频率（又译：时钟频率速度，英语：clock rate），是指同步电路中时钟的基础频率，它以“若干次周期每秒”来度量，量度单位采用SI单位赫兹（Hz）。它是评定CPU性能的重要指标。一般来说主频数字值越大越好。外频，是CPU外部的工作频率，是由主板提供的基准时钟频率。FSB频率，是连接CPU和主板芯片组中的北桥芯片的前端总线（Front Side Bus）上的数据传输频率。... 时钟频率（又译：时钟频率速度，英语：clock rate），是指同步电路中时钟的基础频率，它以“若干次周期每秒”来度量，量度单位采用SI单位赫兹（Hz）。它是评定CPU性能的重要指标。一般来说主频数字值越大越好。外频，是CPU外部的工作频率，是由主板提供的基准时钟频率。FSB频率，是连接CPU和主板芯片组中的北桥芯片的前端总线（Front Side Bus）上的数据传输频率。...
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