- ChipScope Pro内核插入器 ChipScope Pro内核插入器的文件后缀名为cdc。在ISE工程中可以创建一个新的cdc程序，也可以在实现流程中激活内核插入器。 注意：使用内核插入器之前，要注意一些工程项目的属性设臵。 (1) 如果采用XST综合工具，将【Keep Hierarchy】属性设置成【Yes】或【Soft】，禁止XST工具对设计的优化，保留原来设计层次... ChipScope Pro内核插入器 ChipScope Pro内核插入器的文件后缀名为cdc。在ISE工程中可以创建一个新的cdc程序，也可以在实现流程中激活内核插入器。 注意：使用内核插入器之前，要注意一些工程项目的属性设臵。 (1) 如果采用XST综合工具，将【Keep Hierarchy】属性设置成【Yes】或【Soft】，禁止XST工具对设计的优化，保留原来设计层次...
- 使用【Sources】源文件视图和RTL编辑器 PlanAhead允许导入多种不同类型的源文件，包括HDL和NGC核。在RTL编辑器中可以打开、编辑、开发RTL源文件。下面我们介绍【Sources】源文件视图和RTL编辑器的使用。 1. 认识【Sources】源文件视图。 源文件视图显示方式：在【Sources】源文件视图窗口单击，最大化此窗口，如图10-9所示。... 使用【Sources】源文件视图和RTL编辑器 PlanAhead允许导入多种不同类型的源文件，包括HDL和NGC核。在RTL编辑器中可以打开、编辑、开发RTL源文件。下面我们介绍【Sources】源文件视图和RTL编辑器的使用。 1. 认识【Sources】源文件视图。 源文件视图显示方式：在【Sources】源文件视图窗口单击，最大化此窗口，如图10-9所示。...
- 什么是预训练网络 一个常用、高效的在小图像数据集上深度学习的方法就是利用预训练网络。一个预训练网络只是简单的储存了之前在大的数据集训练的结果，通常是大的图像分类任务。如果原始的数据集已经足够大，足够一般，通过预训练学习到的空间上的特征层次结构就能有效地在我们的模型中工作，因此这些特征对许多计算机视觉问题都很有用，尽管这些新问题和原任务相比可能涉及完全不同的类别。 K... 什么是预训练网络 一个常用、高效的在小图像数据集上深度学习的方法就是利用预训练网络。一个预训练网络只是简单的储存了之前在大的数据集训练的结果，通常是大的图像分类任务。如果原始的数据集已经足够大，足够一般，通过预训练学习到的空间上的特征层次结构就能有效地在我们的模型中工作，因此这些特征对许多计算机视觉问题都很有用，尽管这些新问题和原任务相比可能涉及完全不同的类别。 K...
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- 时钟资源 为了更好的控制时钟，Virtex-6器件分成若干个时钟区域，最小器件有6个区域，最大器件有18个区域。每个时钟区域高40个CLB。在时钟设计中，推荐使用片上专用的时钟资源，不推荐使用本地时钟（如逻辑产生的时钟）。 每个Virtex-6的中间列包含了专门配置引脚（CFG），该列的其余区域为CLB。其右边排列着一个CMT列。每个区域（40个CLB高）对应一个... 时钟资源 为了更好的控制时钟，Virtex-6器件分成若干个时钟区域，最小器件有6个区域，最大器件有18个区域。每个时钟区域高40个CLB。在时钟设计中，推荐使用片上专用的时钟资源，不推荐使用本地时钟（如逻辑产生的时钟）。 每个Virtex-6的中间列包含了专门配置引脚（CFG），该列的其余区域为CLB。其右边排列着一个CMT列。每个区域（40个CLB高）对应一个...
- 背景 之前写过一篇博文：Xilinx IP核专题之PLL IP核介绍，讲的是如何用ISE的CORE generator产生一个PLL核的实际实现过程，写的也比较仔细，里面的参数是根据数据手册了解的，自从那篇博文写完之后，我一直觉得这样的理解还比较浅显，于是有了今天的这篇博文，一起认识一下这个时钟核的架构。 The Clocking Wizard generates ... 背景 之前写过一篇博文：Xilinx IP核专题之PLL IP核介绍，讲的是如何用ISE的CORE generator产生一个PLL核的实际实现过程，写的也比较仔细，里面的参数是根据数据手册了解的，自从那篇博文写完之后，我一直觉得这样的理解还比较浅显，于是有了今天的这篇博文，一起认识一下这个时钟核的架构。 The Clocking Wizard generates ...
- 周期约束 周期概念是FPGA/ASIC时序定义的基础，周期（PERIOD）约束附加在时钟网线上，时序分析工具根据PERIOD约束检查时钟域内所有同步元件（包括寄存器、锁存器、同步RAM/ROM等）的时序是否满足要求。 PERIOD约束会自动处理寄存器时钟端的反相问题。如果相邻同步元件的时钟相位相反，那么它们之间的延时将被默认限制为PERIOD约束值的一半。 PERIOD... 周期约束 周期概念是FPGA/ASIC时序定义的基础，周期（PERIOD）约束附加在时钟网线上，时序分析工具根据PERIOD约束检查时钟域内所有同步元件（包括寄存器、锁存器、同步RAM/ROM等）的时序是否满足要求。 PERIOD约束会自动处理寄存器时钟端的反相问题。如果相邻同步元件的时钟相位相反，那么它们之间的延时将被默认限制为PERIOD约束值的一半。 PERIOD...
- pdf版下载地址：http://pan.baidu.com/s/1hrKoza8 文件名：ccsa9 第九章 9-1 简述国内外组态软件现状。 组态软件产品于20 世纪80 年代初出现，并在80 年代末期进入我国。但在90 年代中期之前，组态软件在我国的应用并不普及。究其原因，大致有以下几点： ⑴国内用户还缺乏对组态软件的认识，项目中没有组态软件的预算，或... pdf版下载地址：http://pan.baidu.com/s/1hrKoza8 文件名：ccsa9 第九章 9-1 简述国内外组态软件现状。 组态软件产品于20 世纪80 年代初出现，并在80 年代末期进入我国。但在90 年代中期之前，组态软件在我国的应用并不普及。究其原因，大致有以下几点： ⑴国内用户还缺乏对组态软件的认识，项目中没有组态软件的预算，或...
- 最早用于搜索雷达的电磁波波长为23cm，这一波段被定义为L波段（英语Long的字头），后来这一波段的中心波长变为22cm。 当波长为10cm的电磁波被使用后，其波段被定义为S波段(英语Short的字头，意为比原有波长短的电磁波）。 在主要使用3cm电磁波的火控雷达出现后，3cm波长的电磁波被称为X波段，因为X代表座标上的某点。 为了结合X波段和S波段的优点，逐渐出现了使... 最早用于搜索雷达的电磁波波长为23cm，这一波段被定义为L波段（英语Long的字头），后来这一波段的中心波长变为22cm。 当波长为10cm的电磁波被使用后，其波段被定义为S波段(英语Short的字头，意为比原有波长短的电磁波）。 在主要使用3cm电磁波的火控雷达出现后，3cm波长的电磁波被称为X波段，因为X代表座标上的某点。 为了结合X波段和S波段的优点，逐渐出现了使...
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